{"id":11866,"date":"2025-09-26T11:43:23","date_gmt":"2025-09-26T03:43:23","guid":{"rendered":"https:\/\/www.oscoo.com\/?p=11866"},"modified":"2025-11-12T17:12:15","modified_gmt":"2025-11-12T09:12:15","slug":"ddr4-to-ddr5-migration-enters-a-critical-phase","status":"publish","type":"post","link":"https:\/\/www.oscoo.com\/pt\/news\/ddr4-to-ddr5-migration-enters-a-critical-phase\/","title":{"rendered":"A migra\u00e7\u00e3o de DDR4 para DDR5 entra numa fase cr\u00edtica"},"content":{"rendered":"
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Nos \u00faltimos anos, a transi\u00e7\u00e3o da DDR4 para a DDR5 foi muitas vezes considerada uma \"queima lenta\". Embora a DDR5 ofere\u00e7a vantagens tecnol\u00f3gicas, a sua ado\u00e7\u00e3o foi travada por restri\u00e7\u00f5es de custo, compatibilidade e ecossistema. No entanto, na segunda metade de 2025, muitos sinais t\u00e9cnicos e de mercado est\u00e3o a come\u00e7ar a apontar para uma nova realidade: a transi\u00e7\u00e3o est\u00e1 a entrar numa fase cr\u00edtica. Por outras palavras, a DDR5 est\u00e1 a sair da sua fase piloto e a DDR4 est\u00e1 a ser gradualmente eliminada.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Oferta e procura no mercado, e tend\u00eancias de pre\u00e7os<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Um dos sinais mais claros \u00e9 a tend\u00eancia de pre\u00e7os contra-intuitiva dos \u00faltimos tempos - a DDR4 da gera\u00e7\u00e3o mais antiga \u00e9, em alguns casos, mais cara do que a DDR5.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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De acordo com a TrendForce, prev\u00ea-se que os pre\u00e7os contratuais da DDR4 em outubro de 2025 aumentem mais de 10%, enquanto os pre\u00e7os \u00e0 vista podem subir 15% ou mais. Entretanto, os pre\u00e7os contratuais e \u00e0 vista da DDR5 tamb\u00e9m poder\u00e3o aumentar, na ordem dos 10-25%. Simultaneamente, prev\u00ea-se que a oferta de DDR4 e LPDDR4 se torne mais restrita no segundo semestre de 2025, fazendo subir os pre\u00e7os.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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J\u00e1 no in\u00edcio de 2025, os pre\u00e7os spot das DDR4 come\u00e7aram a aumentar. Alguns relat\u00f3rios indicam que, a partir de maio de 2025, os pre\u00e7os das DDR4 aumentaram rapidamente - m\u00f3dulos como os de 8 GB registaram aumentos de cerca de 50%. Em junho, alguns chips DDR4 de 16 Gb foram cotados a pre\u00e7os t\u00e3o elevados como $12,50 por chip (ou mesmo mais), enquanto os chips DDR5 de capacidade e velocidade compar\u00e1veis se mantiveram relativamente est\u00e1veis ou subiram mais lentamente. Este fen\u00f3meno - a norma mais antiga a tornar-se mais cara do que a mais recente - reflecte a tens\u00e3o na oferta de DDR4 sob as press\u00f5es sobrepostas da migra\u00e7\u00e3o.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Porque \u00e9 que isto est\u00e1 a acontecer? No fundo, os principais fabricantes est\u00e3o a reduzir gradualmente o processo e a capacidade das DDR4, reafectando recursos para as DDR5, HBM<\/span><\/a>e outras solu\u00e7\u00f5es de mem\u00f3ria avan\u00e7adas. A TrendForce observa que a sa\u00edda da capacidade DDR4 e os ajustes na estrutura de fornecimento s\u00e3o as principais causas dessa distor\u00e7\u00e3o de pre\u00e7os. Como a demanda de IA, nuvem e aplicativos de ponta est\u00e1 levando os fabricantes a favorecer produtos de maior valor, o DDR4 se torna mais um ato marginal ou de equil\u00edbrio.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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No que respeita \u00e0s DDR5, os aumentos de pre\u00e7os continuam a ser mais moderados. A TrendForce prev\u00ea que a DDR5 poder\u00e1 aumentar 3-8% no terceiro trimestre de 2025, enquanto a LPDDR5X poder\u00e1 registar aumentos de 5-10%. Uma vez que o mercado global de DRAM continua a ser apertado, os fabricantes est\u00e3o a concentrar a aten\u00e7\u00e3o na DDR5, HBM e outros segmentos premium, o que poder\u00e1 manter a press\u00e3o ascendente sobre os pre\u00e7os da DDR5.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Em suma, as tend\u00eancias da oferta e dos pre\u00e7os indicam que a DDR4 est\u00e1 a ser marginalizada, enquanto a janela de mercado da DDR5 est\u00e1 a abrir-se.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Evolu\u00e7\u00e3o t\u00e9cnica e progresso do processo<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Uma migra\u00e7\u00e3o bem-sucedida n\u00e3o pode depender apenas de propaganda - uma base t\u00e9cnica s\u00f3lida \u00e9 essencial. A DDR5 n\u00e3o \u00e9 simplesmente uma DDR4 mais r\u00e1pida; introduz altera\u00e7\u00f5es na arquitetura, no controlo, na pot\u00eancia e na fiabilidade.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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De um ponto de vista arquitet\u00f3nico, a DDR5 introduz dois subcanais de 32 bits num \u00fanico DIMM, melhorando a forma como a mem\u00f3ria lida com o acesso simult\u00e2neo. Tamb\u00e9m incorpora um regulador de tens\u00e3o no m\u00f3dulo, transferindo algumas responsabilidades de gest\u00e3o de energia da placa-m\u00e3e para o pr\u00f3prio m\u00f3dulo. Isto ajuda a simplificar o design da placa-m\u00e3e e a melhorar a integridade do sinal.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Em termos de desempenho, a DDR5 pode ser escalada para frequ\u00eancias e larguras de banda mais altas. Os primeiros m\u00f3dulos DDR5 geralmente come\u00e7am com 4800 MT\/s como linha de base, mas a especifica\u00e7\u00e3o DDR5 permite expans\u00f5es para 6400, 7200 MT\/s e al\u00e9m. As normas DDR5 em evolu\u00e7\u00e3o do JEDEC tamb\u00e9m incluem ECC (corre\u00e7\u00e3o de erros) integrado, mecanismos de atualiza\u00e7\u00e3o de v\u00e1rios n\u00edveis e t\u00e9cnicas melhoradas de equaliza\u00e7\u00e3o e sinaliza\u00e7\u00e3o para aumentar a estabilidade. Algumas propostas acad\u00e9micas (por exemplo, para atenuar o \"row-hammer\") est\u00e3o mesmo a explorar protec\u00e7\u00f5es finas no \u00e2mbito da DDR5 para reduzir a sobrecarga de desempenho das medidas de estabilidade.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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No entanto, estas melhorias t\u00eam custos: A maior complexidade da DDR5 exige melhores rendimentos e toler\u00e2ncias mais rigorosas, tornando-a inicialmente mais cara por unidade do que a DDR4. Consequentemente, os fabricantes que promovem a DDR5 precocemente t\u00eam de absorver maiores riscos de I&D e de rendimento.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Do lado do processo, os principais fornecedores de DRAM (Samsung, SK Hynix, Micron, etc.) est\u00e3o a conduzir a DDR5 para n\u00f3s de processo mais avan\u00e7ados. Est\u00e3o a trabalhar com n\u00f3s 1\u03b3 \/ 1\u03b4 e mais al\u00e9m para aumentar a densidade e diminuir o consumo de energia. \u00c0 medida que o rendimento do processo melhora, o custo por bit da DDR5 diminui, permitindo-lhe competir mais diretamente com a DDR4 em termos de pre\u00e7o.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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\u00c9 tamb\u00e9m importante notar que a DDR5 n\u00e3o \u00e9 a \u00fanica dire\u00e7\u00e3o futura. A mem\u00f3ria de alta largura de banda (HBM), a mem\u00f3ria empilhada em 3D, a mem\u00f3ria com extens\u00e3o CXL e outras arquitecturas est\u00e3o a ser desenvolvidas em paralelo. Em alguns casos de uso especializados ou de alta demanda, a DDR5 pode coexistir com essas tecnologias ou ceder a elas. No ecossistema de mem\u00f3ria mais amplo, \u00e9 prov\u00e1vel que a DDR5 desempenhe o papel de \"mem\u00f3ria principal de uso geral + taxa de transfer\u00eancia m\u00e9dia a alta\" em vez de ser a solu\u00e7\u00e3o extrema definitiva.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Estrat\u00e9gias do sector e din\u00e2mica da cadeia de abastecimento<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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No percurso de migra\u00e7\u00e3o, diferentes intervenientes desempenham diferentes pap\u00e9is: h\u00e1 os primeiros a adotar, os seguidores cautelosos e os que s\u00e3o for\u00e7ados a transformar-se.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Ao n\u00edvel dos chips DRAM (Samsung, SK Hynix, Micron, etc.), a tend\u00eancia \u00e9 transferir recursos para a DDR5 e HBM, ao mesmo tempo que se elimina a DDR4. Reconhecendo que a DDR4 est\u00e1 a aproximar-se do fim do seu ciclo de vida, estas empresas t\u00eam de gerir a retirada de processos antigos enquanto investem fortemente em novos processos.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Dito isto, alguns fornecedores mais pequenos ou mais centrados na DDR4 (por exemplo, a Nanya) podem beneficiar a curto prazo da escassez da oferta de DDR4 e do aumento dos pre\u00e7os. Alguns relat\u00f3rios sugerem que a Nanya tem estado ativa nas encomendas recentes de DDR4, ajustando a capacidade para responder \u00e0 procura. Esta abordagem pode produzir ganhos a curto prazo, mas carece de sustentabilidade a longo prazo.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Os fabricantes de m\u00f3dulos, as marcas de mem\u00f3ria e os ODM enfrentam o desafio de reestruturar as linhas de produtos. As marcas originalmente focadas em DDR4 precisam de desenvolver ofertas de DDR5. No per\u00edodo de transi\u00e7\u00e3o, as linhas mistas de DDR4 + DDR5, os pre\u00e7os diferenciados, a diferencia\u00e7\u00e3o de desempenho, as solu\u00e7\u00f5es t\u00e9rmicas, as garantias de estabilidade e as funcionalidades de overclocking tornam-se alavancas competitivas.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Os fabricantes de placas-m\u00e3e, CPUs e plataformas t\u00eam um papel fundamental na ado\u00e7\u00e3o da DDR5. Muitos processadores e plataformas de nova gera\u00e7\u00e3o assumem agora o suporte de DDR5, deixando efetivamente de lado a DDR4. Esses fabricantes de plataformas tamb\u00e9m precisam investir em BIOS, controladores de mem\u00f3ria, ajuste de compatibilidade, otimiza\u00e7\u00e3o de tempo, integridade de sinal e garantia de estabilidade. Ao mesmo tempo, para ajudar os clientes existentes, alguns podem fornecer solu\u00e7\u00f5es compat\u00edveis com as vers\u00f5es anteriores ou de f\u00e1cil migra\u00e7\u00e3o.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Os integradores de sistemas a jusante, OEMs e clientes finais tamb\u00e9m s\u00e3o partes interessadas importantes. Nesta fase cr\u00edtica, eles devem tomar decis\u00f5es de aquisi\u00e7\u00e3o, invent\u00e1rio e posicionamento de produtos: devem adotar a DDR5 agora ou adiar a DDR4 para poupar custos? As configura\u00e7\u00f5es h\u00edbridas, as estrat\u00e9gias de comuta\u00e7\u00e3o flex\u00edveis e os designs de compatibilidade tornam-se t\u00e1cticas essenciais.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Riscos e desafios<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Embora a tend\u00eancia da migra\u00e7\u00e3o seja clara, o caminho est\u00e1 longe de ser isento de riscos.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Em primeiro lugar, o risco de custos e pre\u00e7os continua a ser importante. A DDR5 ainda se encontra numa fase de custos relativamente elevados; se o seu pre\u00e7o for demasiado elevado, a aceita\u00e7\u00e3o pelo mercado de massas poder\u00e1 estagnar. Mesmo que os custos baixem, continua a ser incerto se os pre\u00e7os de mercado seguir\u00e3o o mesmo ritmo.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Em segundo lugar, as preocupa\u00e7\u00f5es com a compatibilidade e a estabilidade s\u00e3o reais. Durante a transi\u00e7\u00e3o, as placas-m\u00e3e, os controladores de mem\u00f3ria, o BIOS, os drivers, o ajuste de tempo e a integridade do sinal s\u00e3o todos pontos de falha potenciais. Os primeiros m\u00f3dulos DDR5 podem sofrer problemas inesperados de estabilidade ou compatibilidade; uma m\u00e1 experi\u00eancia inicial pode diminuir a confian\u00e7a dos utilizadores e atrasar a ado\u00e7\u00e3o.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Em terceiro lugar, os estrangulamentos no fornecimento e na produ\u00e7\u00e3o podem atrasar o progresso. Se a acelera\u00e7\u00e3o do processo DDR5 for mais lenta do que o esperado, ou se os principais materiais e equipamentos sofrerem restri\u00e7\u00f5es, a transi\u00e7\u00e3o atrasar-se-\u00e1. Al\u00e9m disso, a manuten\u00e7\u00e3o de processos antigos para a DDR4 e o suporte \u00e0 DDR5 introduzem concorr\u00eancia de recursos e tens\u00e3o estrat\u00e9gica.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Em quarto lugar, a aceita\u00e7\u00e3o do mercado e a concorr\u00eancia de tecnologias alternativas representam uma amea\u00e7a. Alguns dispositivos de baixo custo, sistemas incorporados ou aplica\u00e7\u00f5es industriais podem continuar a depender da DDR4 ou de mem\u00f3rias de n\u00edvel inferior. At\u00e9 que os perfis de custo e energia da DDR5 se normalizem totalmente, essas aplica\u00e7\u00f5es podem resistir \u00e0 migra\u00e7\u00e3o. Al\u00e9m disso, tecnologias como a mem\u00f3ria estendida CXL, arquitecturas de mem\u00f3ria heterog\u00e9neas e integra\u00e7\u00f5es de computa\u00e7\u00e3o na mem\u00f3ria ou mem\u00f3ria + processamento podem desafiar o dom\u00ednio da DRAM padr\u00e3o.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Por \u00faltimo, os ciclos macroecon\u00f3micos, os ajustamentos das exist\u00eancias e as perturba\u00e7\u00f5es da cadeia de abastecimento ou das pol\u00edticas s\u00e3o um risco. Os ciclos da ind\u00fastria da mem\u00f3ria s\u00e3o vol\u00e1teis; as oscila\u00e7\u00f5es da procura, os excessos de exist\u00eancias, as pol\u00edticas comerciais e os riscos da cadeia de abastecimento podem fazer descarrilar a din\u00e2mica da migra\u00e7\u00e3o.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Quando \u00e9 que come\u00e7a o \"novo normal\"?<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Nesta fase de rutura, a quest\u00e3o crucial \u00e9: como saber quando \u00e9 que o \"ponto de inflex\u00e3o\" da transi\u00e7\u00e3o chegou verdadeiramente? Podemos seguir v\u00e1rios indicadores:<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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  • A velocidade de decl\u00ednio da quota de capacidade e do volume de vendas da DDR4. Se entrarmos numa fase de descida r\u00e1pida, isso significa que a DDR4 est\u00e1 a entrar numa fase de elimina\u00e7\u00e3o acelerada.<\/li>
  • A taxa de penetra\u00e7\u00e3o e os fornecimentos de DDR5 est\u00e3o a atingir um ponto de viragem, especialmente quando domina os principais mercados (PC, servidores, nuvem).<\/li>
  • A redu\u00e7\u00e3o ou elimina\u00e7\u00e3o das diferen\u00e7as de pre\u00e7o entre a DDR4 e a DDR5 - ou o desaparecimento de qualquer invers\u00e3o de pre\u00e7os - \u00e9 sinal de um mercado maduro.<\/li>
  • Os an\u00fancios p\u00fablicos dos fabricantes, os movimentos de capital, as altera\u00e7\u00f5es no planeamento da capacidade e as mudan\u00e7as na carteira de produtos s\u00e3o tamb\u00e9m fortes ind\u00edcios.<\/li>
  • \u00c9 igualmente necess\u00e1rio ter em conta os mercados segmentados: os ritmos de ado\u00e7\u00e3o diferem entre os PC de consumo, os servidores\/centros de dados e os sistemas incorporados\/industriais.<\/li><\/ul>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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    Com base nos dados p\u00fablicos actuais e nas projec\u00e7\u00f5es da ind\u00fastria, \u00e9 prov\u00e1vel que este per\u00edodo cr\u00edtico surja no final de 2025 at\u00e9 ao in\u00edcio de 2026. Isso significa que, a partir da segunda metade de 2025, a penetra\u00e7\u00e3o da DDR5 em determinados segmentos pode acelerar e a sa\u00edda da DDR4 tornar-se-\u00e1 mais vis\u00edvel. Em meados de 2026, a DDR5 pode muito bem tornar-se a norma dominante, enquanto a DDR4 se retira para pap\u00e9is marginais ou de nicho.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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    Conclus\u00e3o e perspectivas<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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    A transi\u00e7\u00e3o da DDR4 para a DDR5 \u00e9 muito mais do que \"apenas uma mem\u00f3ria mais r\u00e1pida\". Envolve complexidade t\u00e9cnica, reafecta\u00e7\u00e3o de recursos, reestrutura\u00e7\u00e3o do mercado e coordena\u00e7\u00e3o do ecossistema a jusante. Estamos agora num ponto de viragem estrutural: A DDR5 est\u00e1 a ganhar condi\u00e7\u00f5es t\u00e9cnicas e de mercado para se expandir, e o espa\u00e7o de sobreviv\u00eancia da DDR4 est\u00e1 a diminuir.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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    Nos pr\u00f3ximos 3 a 5 anos, a penetra\u00e7\u00e3o da DDR5 passar\u00e1 das plataformas topo de gama para os segmentos mainstream, os custos diminuir\u00e3o e o apoio do ecossistema refor\u00e7ar-se-\u00e1. Entretanto, as aplica\u00e7\u00f5es de elevada largura de banda ou de ultra-alta densidade podem migrar gradualmente para HBM, arquitecturas de mem\u00f3ria heterog\u00e9neas ou integra\u00e7\u00f5es de mem\u00f3ria + computa\u00e7\u00e3o. Por outras palavras, a DDR5 n\u00e3o \u00e9 a fronteira final, mas um dos pilares fundamentais do futuro ecossistema de mem\u00f3ria.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t<\/div>","protected":false},"excerpt":{"rendered":"

    at\u00e9 \u00e0 segunda metade de 2025, muitos sinais t\u00e9cnicos e de mercado come\u00e7am a apontar para uma nova realidade: a transi\u00e7\u00e3o est\u00e1 a entrar numa fase cr\u00edtica. Por outras palavras, a DDR5 est\u00e1 a sair da sua fase piloto e a DDR4 est\u00e1 a ser gradualmente eliminada.<\/p>","protected":false},"author":4,"featured_media":11868,"comment_status":"closed","ping_status":"closed","sticky":false,"template":"","format":"standard","meta":{"_acf_changed":false,"site-sidebar-layout":"default","site-content-layout":"","ast-site-content-layout":"default","site-content-style":"default","site-sidebar-style":"default","ast-global-header-display":"","ast-banner-title-visibility":"","ast-main-header-display":"","ast-hfb-above-header-display":"","ast-hfb-below-header-display":"","ast-hfb-mobile-header-display":"","site-post-title":"","ast-breadcrumbs-content":"","ast-featured-img":"","footer-sml-layout":"","theme-transparent-header-meta":"","adv-header-id-meta":"","stick-header-meta":"","header-above-stick-meta":"","header-main-stick-meta":"","header-below-stick-meta":"","astra-migrate-meta-layouts":"set","ast-page-background-enabled":"default","ast-page-background-meta":{"desktop":{"background-color":"var(--ast-global-color-4)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"tablet":{"background-color":"","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"mobile":{"background-color":"","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""}},"ast-content-background-meta":{"desktop":{"background-color":"var(--ast-global-color-5)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"tablet":{"background-color":"var(--ast-global-color-5)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"mobile":{"background-color":"var(--ast-global-color-5)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""}},"footnotes":""},"categories":[52],"tags":[],"class_list":["post-11866","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-industry-news"],"acf":[],"_links":{"self":[{"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/posts\/11866","targetHints":{"allow":["GET"]}}],"collection":[{"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/posts"}],"about":[{"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/types\/post"}],"author":[{"embeddable":true,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/users\/4"}],"replies":[{"embeddable":true,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/comments?post=11866"}],"version-history":[{"count":3,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/posts\/11866\/revisions"}],"predecessor-version":[{"id":13147,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/posts\/11866\/revisions\/13147"}],"wp:featuredmedia":[{"embeddable":true,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/media\/11868"}],"wp:attachment":[{"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/media?parent=11866"}],"wp:term":[{"taxonomy":"category","embeddable":true,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/categories?post=11866"},{"taxonomy":"post_tag","embeddable":true,"href":"https:\/\/www.oscoo.com\/pt\/wp-json\/wp\/v2\/tags?post=11866"}],"curies":[{"name":"wp","href":"https:\/\/api.w.org\/{rel}","templated":true}]}}