{"id":11866,"date":"2025-09-26T11:43:23","date_gmt":"2025-09-26T03:43:23","guid":{"rendered":"https:\/\/www.oscoo.com\/?p=11866"},"modified":"2025-11-12T17:12:15","modified_gmt":"2025-11-12T09:12:15","slug":"ddr4-to-ddr5-migration-enters-a-critical-phase","status":"publish","type":"post","link":"https:\/\/www.oscoo.com\/fr\/news\/ddr4-to-ddr5-migration-enters-a-critical-phase\/","title":{"rendered":"La migration de la DDR4 vers la DDR5 entre dans une phase critique"},"content":{"rendered":"
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Au cours des derni\u00e8res ann\u00e9es, la transition de la DDR4 \u00e0 la DDR5 a souvent \u00e9t\u00e9 consid\u00e9r\u00e9e comme une \"combustion lente\". Bien que la DDR5 offre des avantages technologiques, son adoption a \u00e9t\u00e9 frein\u00e9e par des contraintes de co\u00fbt, de compatibilit\u00e9 et d'\u00e9cosyst\u00e8me. Toutefois, d'ici la seconde moiti\u00e9 de 2025, de nombreux signaux commerciaux et techniques commencent \u00e0 indiquer une nouvelle r\u00e9alit\u00e9 : la transition entre dans une phase critique. En d'autres termes, la DDR5 sort de sa phase pilote et la DDR4 est progressivement \u00e9vinc\u00e9e.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Offre et demande sur le march\u00e9 et tendances des prix<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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L'un des signes les plus \u00e9vidents est la tendance tarifaire contre-intuitive observ\u00e9e ces derniers temps - la DDR4 d'ancienne g\u00e9n\u00e9ration est, dans certains cas, plus ch\u00e8re que la DDR5.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Selon TrendForce, les prix contractuels des DDR4 en octobre 2025 devraient augmenter de plus de 10%, tandis que les prix au comptant pourraient augmenter de 15% ou plus. Parall\u00e8lement, les prix contractuels et au comptant des DDR5 pourraient \u00e9galement augmenter, de l'ordre de 10 \u00e0 25%. Dans le m\u00eame temps, l'offre de DDR4 et de LPDDR4 devrait se resserrer davantage au cours du second semestre 2025, ce qui entra\u00eenera une hausse des prix.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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D\u00e8s le d\u00e9but de l'ann\u00e9e 2025, les prix au comptant de la DDR4 ont commenc\u00e9 \u00e0 monter en fl\u00e8che. Certains rapports indiquent qu'\u00e0 partir de mai 2025, les prix de la DDR4 ont augment\u00e9 rapidement - des modules de 8 Go ont connu des augmentations d'environ 50%. En juin, certaines puces DDR4 de 16 Go \u00e9taient cot\u00e9es \u00e0 des prix atteignant $12,50 par puce (voire plus), tandis que les puces DDR5 de capacit\u00e9 et de vitesse comparables restaient relativement stables ou augmentaient plus lentement. Ce ph\u00e9nom\u00e8ne - la norme la plus ancienne devenant plus ch\u00e8re que la plus r\u00e9cente - refl\u00e8te la tension de l'offre de DDR4 sous l'effet des pressions migratoires qui se chevauchent.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Pourquoi en est-il ainsi ? \u00c0 la base, les principaux fabricants r\u00e9duisent progressivement le processus et la capacit\u00e9 de la DDR4 et r\u00e9affectent leurs ressources \u00e0 la DDR5, HBM<\/span><\/a>et d'autres solutions de m\u00e9moire avanc\u00e9es. TrendForce note que la sortie de la capacit\u00e9 DDR4 et les ajustements de la structure de l'offre sont les principales causes de cette distorsion des prix. Parce que la demande de l'IA, du cloud et des applications haut de gamme pousse les fabricants \u00e0 favoriser les produits de plus grande valeur, la DDR4 devient plus marginale ou un acte d'\u00e9quilibrage.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Du c\u00f4t\u00e9 des DDR5, les augmentations de prix restent plus mod\u00e9r\u00e9es. TrendForce pr\u00e9voit que la DDR5 pourrait augmenter de 3-8% au troisi\u00e8me trimestre 2025, tandis que la LPDDR5X pourrait conna\u00eetre des augmentations de 5-10%. \u00c9tant donn\u00e9 que le march\u00e9 global des DRAM reste tendu, les fabricants concentrent leur attention sur la DDR5, la HBM et d'autres segments haut de gamme, ce qui pourrait maintenir une pression \u00e0 la hausse sur les prix de la DDR5.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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En r\u00e9sum\u00e9, les tendances en mati\u00e8re d'offre et de prix indiquent que la DDR4 est en train d'\u00eatre marginalis\u00e9e, tandis que la fen\u00eatre de march\u00e9 de la DDR5 est en train de s'ouvrir.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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\u00c9volution technique et progr\u00e8s des processus<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Une migration r\u00e9ussie ne peut s'appuyer uniquement sur le battage m\u00e9diatique - un solide travail de fond technique est essentiel. La DDR5 n'est pas simplement une DDR4 plus rapide ; elle introduit des changements au niveau de l'architecture, du contr\u00f4le, de la puissance et de la fiabilit\u00e9.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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D'un point de vue architectural, la DDR5 introduit deux sous-canaux de 32 bits dans un seul module DIMM, ce qui am\u00e9liore la fa\u00e7on dont la m\u00e9moire g\u00e8re les acc\u00e8s simultan\u00e9s. Elle int\u00e8gre \u00e9galement un r\u00e9gulateur de tension sur le module, transf\u00e9rant certaines responsabilit\u00e9s de gestion de l'alimentation de la carte m\u00e8re au module lui-m\u00eame. Cela permet de simplifier la conception de la carte m\u00e8re et d'am\u00e9liorer l'int\u00e9grit\u00e9 du signal.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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En termes de performances, la DDR5 peut \u00e9voluer vers des fr\u00e9quences et des bandes passantes plus \u00e9lev\u00e9es. Les premiers modules DDR5 commencent souvent \u00e0 4800 MT\/s comme base, mais la sp\u00e9cification DDR5 permet des extensions \u00e0 6400, 7200 MT\/s et au-del\u00e0. Les normes DDR5 \u00e9volutives du JEDEC comprennent \u00e9galement un syst\u00e8me ECC (correction d'erreurs) embarqu\u00e9, des m\u00e9canismes de rafra\u00eechissement \u00e0 plusieurs niveaux et des techniques d'\u00e9galisation et de signal am\u00e9lior\u00e9es pour renforcer la stabilit\u00e9. Certaines propositions universitaires (par exemple, pour att\u00e9nuer les effets du \"row-hammer\") explorent m\u00eame des protections \u00e0 grain fin au sein de la DDR5 afin de r\u00e9duire les surco\u00fbts de performance des mesures de stabilit\u00e9.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Toutefois, ces am\u00e9liorations ont un co\u00fbt : La plus grande complexit\u00e9 de la DDR5 exige de meilleurs rendements et des tol\u00e9rances plus strictes, ce qui la rend initialement plus ch\u00e8re par unit\u00e9 que la DDR4. Par cons\u00e9quent, les fabricants qui font la promotion pr\u00e9coce de la DDR5 doivent absorber des risques plus \u00e9lev\u00e9s en mati\u00e8re de R&D et de rendement.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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En ce qui concerne le processus, les principaux fournisseurs de DRAM (Samsung, SK Hynix, Micron, etc.) orientent la DDR5 vers des n\u0153uds de processus plus avanc\u00e9s. Ils travaillent avec des n\u0153uds 1\u03b3 \/ 1\u03b4 et au-del\u00e0 pour augmenter la densit\u00e9 et r\u00e9duire la consommation d'\u00e9nergie. Avec l'am\u00e9lioration du rendement des processus, le co\u00fbt par bit de la DDR5 diminuera, ce qui lui permettra de concurrencer plus directement la DDR4 en termes de prix.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Il est \u00e9galement important de noter que la DDR5 n'est pas la seule voie d'avenir. La m\u00e9moire \u00e0 grande largeur de bande (HBM), la m\u00e9moire empil\u00e9e en 3D, la m\u00e9moire \u00e9tendue CXL et d'autres architectures se d\u00e9veloppent en parall\u00e8le. Dans certains cas d'utilisation sp\u00e9cialis\u00e9s ou \u00e0 forte demande, la DDR5 pourrait coexister avec ces technologies ou leur c\u00e9der la place. Dans l'\u00e9cosyst\u00e8me plus large de la m\u00e9moire, la DDR5 jouera probablement le r\u00f4le de \"m\u00e9moire principale polyvalente + d\u00e9bit moyen \u00e0 \u00e9lev\u00e9\" plut\u00f4t que celui de solution extr\u00eame ultime.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Strat\u00e9gies industrielles et dynamique de la cha\u00eene d'approvisionnement<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Sur le chemin de la migration, diff\u00e9rents acteurs jouent des r\u00f4les diff\u00e9rents : il y a les adeptes pr\u00e9coces, les suiveurs prudents et ceux qui sont forc\u00e9s de se transformer.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Au niveau des puces DRAM (Samsung, SK Hynix, Micron, etc.), la tendance est de transf\u00e9rer les ressources vers DDR5 et HBM tout en abandonnant progressivement DDR4. Conscientes que la DDR4 approche de la fin de son cycle de vie, ces entreprises doivent g\u00e9rer le retrait des anciens processus tout en investissant massivement dans les nouveaux.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Cela dit, certains fournisseurs plus petits ou plus ax\u00e9s sur la DDR4 (par exemple Nanya) pourraient b\u00e9n\u00e9ficier \u00e0 court terme de l'\u00e9troitesse de l'offre de DDR4 et de la flamb\u00e9e des prix. Certains rapports sugg\u00e8rent que Nanya a \u00e9t\u00e9 actif dans les r\u00e9centes commandes de DDR4, ajustant sa capacit\u00e9 pour r\u00e9pondre \u00e0 la demande. Cette approche peut produire des gains \u00e0 court terme, mais elle n'est pas viable \u00e0 long terme.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Les fabricants de modules, les marques de m\u00e9moire et les ODM sont confront\u00e9s au d\u00e9fi de la restructuration des lignes de produits. Les marques qui se concentraient \u00e0 l'origine sur la DDR4 doivent d\u00e9velopper des offres DDR5. Au cours de la p\u00e9riode de transition, les gammes mixtes DDR4 + DDR5, les diff\u00e9rences de prix, la diff\u00e9renciation des performances, les solutions thermiques, les garanties de stabilit\u00e9 et les fonctions d'overclocking deviennent des leviers concurrentiels.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Les fabricants de cartes m\u00e8res, de processeurs et de plates-formes jouent un r\u00f4le essentiel dans l'adoption de la DDR5. De nombreux processeurs et plates-formes de nouvelle g\u00e9n\u00e9ration prennent d\u00e9sormais en charge la DDR5, mettant de fait la DDR4 sur la touche. Ces fabricants de plates-formes doivent \u00e9galement investir dans le BIOS, les contr\u00f4leurs de m\u00e9moire, le r\u00e9glage de la compatibilit\u00e9, l'optimisation de la synchronisation, l'int\u00e9grit\u00e9 du signal et l'assurance de la stabilit\u00e9. Dans le m\u00eame temps, pour aider les clients existants, certains peuvent fournir des solutions r\u00e9trocompatibles ou adapt\u00e9es \u00e0 la migration.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Les int\u00e9grateurs de syst\u00e8mes en aval, les \u00e9quipementiers et les clients finaux sont \u00e9galement des acteurs cl\u00e9s. Au cours de cette phase critique, ils doivent prendre des d\u00e9cisions en mati\u00e8re d'approvisionnement, d'inventaire et de positionnement des produits : doivent-ils adopter la DDR5 maintenant ou attendre la DDR4 pour r\u00e9duire les co\u00fbts ? Les configurations hybrides, les strat\u00e9gies de commutation flexibles et les conceptions de compatibilit\u00e9 deviennent des tactiques essentielles.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Risques et d\u00e9fis<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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M\u00eame si la tendance \u00e0 la migration est claire, le chemin est loin d'\u00eatre sans risque.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Premi\u00e8rement, les risques li\u00e9s aux co\u00fbts et aux prix restent importants. Le DDR5 est encore dans une phase de co\u00fbt relativement \u00e9lev\u00e9 ; si son prix est trop \u00e9lev\u00e9, l'acceptation par le march\u00e9 de masse risque d'\u00eatre bloqu\u00e9e. M\u00eame si les co\u00fbts baissent, il n'est pas certain que les prix du march\u00e9 suivent le mouvement.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Deuxi\u00e8mement, les probl\u00e8mes de compatibilit\u00e9 et de stabilit\u00e9 sont r\u00e9els. Tout au long de la transition, les cartes m\u00e8res, les contr\u00f4leurs de m\u00e9moire, le BIOS, les pilotes, le r\u00e9glage de la synchronisation et l'int\u00e9grit\u00e9 des signaux sont autant de points de d\u00e9faillance potentiels. Les premiers modules DDR5 peuvent souffrir de probl\u00e8mes de stabilit\u00e9 ou de compatibilit\u00e9 inattendus ; une mauvaise exp\u00e9rience initiale pourrait entamer la confiance des utilisateurs et ralentir l'adoption.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Troisi\u00e8mement, les goulets d'\u00e9tranglement au niveau de l'approvisionnement et du rendement peuvent bloquer les progr\u00e8s. Si la mont\u00e9e en puissance du processus DDR5 est plus lente que pr\u00e9vu, ou si des contraintes p\u00e8sent sur les mat\u00e9riaux et \u00e9quipements cl\u00e9s, la transition sera retard\u00e9e. En outre, le maintien des processus existants pour le DDR4 tout en prenant en charge le DDR5 introduit une concurrence au niveau des ressources et des tensions strat\u00e9giques.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Quatri\u00e8mement, l'acceptation du march\u00e9 et la concurrence des technologies alternatives constituent une menace. Certains appareils \u00e0 bas prix, syst\u00e8mes int\u00e9gr\u00e9s ou applications industrielles peuvent continuer \u00e0 utiliser la m\u00e9moire DDR4 ou des m\u00e9moires de niveau inf\u00e9rieur. Jusqu'\u00e0 ce que les profils de co\u00fbt et de puissance de la DDR5 se normalisent compl\u00e8tement, ces applications pourraient r\u00e9sister \u00e0 la migration. En outre, des technologies telles que la m\u00e9moire \u00e9tendue CXL, les architectures de m\u00e9moire h\u00e9t\u00e9rog\u00e8ne et les int\u00e9grations de calcul en m\u00e9moire ou de m\u00e9moire + traitement pourraient remettre en cause la domination de la DRAM standard.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Enfin, les cycles macro\u00e9conomiques, les ajustements de stocks et les perturbations de la cha\u00eene d'approvisionnement ou de la politique sont des facteurs impr\u00e9visibles. Les cycles de l'industrie de la m\u00e9moire sont volatils ; les fluctuations de la demande, les exc\u00e9dents de stocks, les politiques commerciales et les risques li\u00e9s \u00e0 la cha\u00eene d'approvisionnement peuvent faire d\u00e9railler l'\u00e9lan migratoire.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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Quand la \"nouvelle normalit\u00e9\" commencera-t-elle ?<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Dans cette phase de rupture, la question cruciale est la suivante : comment savoir si le \"point d'inflexion\" de la transition est vraiment arriv\u00e9 ? Nous pouvons suivre plusieurs indicateurs :<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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  • La vitesse de d\u00e9clin de la part de capacit\u00e9 et du volume des livraisons de DDR4. Si nous entrons dans une phase de d\u00e9clin rapide, cela signifie que la DDR4 entre dans une phase d'\u00e9limination acc\u00e9l\u00e9r\u00e9e.<\/li>
  • Le taux de p\u00e9n\u00e9tration et les livraisons de DDR5 atteignent un tournant, surtout lorsqu'ils dominent des march\u00e9s cl\u00e9s (PC, serveurs, cloud).<\/li>
  • La r\u00e9duction ou l'\u00e9limination des \u00e9carts de prix entre les DDR4 et les DDR5 - ou la disparition de toute inversion de prix - est le signe d'un march\u00e9 arriv\u00e9 \u00e0 maturit\u00e9.<\/li>
  • Les annonces publiques des fabricants, les mouvements de capitaux, les changements dans la planification des capacit\u00e9s et les modifications du portefeuille de produits sont \u00e9galement des indices importants.<\/li>
  • Il faut \u00e9galement surveiller les march\u00e9s segment\u00e9s : les rythmes d'adoption diff\u00e8rent selon qu'il s'agit de PC grand public, de serveurs\/centres de donn\u00e9es ou de syst\u00e8mes embarqu\u00e9s\/industriels.<\/li><\/ul>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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    D'apr\u00e8s les donn\u00e9es publiques actuelles et les projections de l'industrie, cette p\u00e9riode critique devrait se situer entre la fin de 2025 et le d\u00e9but de 2026. Cela signifie qu'\u00e0 partir du second semestre 2025, la p\u00e9n\u00e9tration de la DDR5 dans certains segments pourrait s'acc\u00e9l\u00e9rer et le retrait de la DDR4 deviendrait plus visible. Au milieu de l'ann\u00e9e 2026, la DDR5 pourrait bien devenir la norme la plus r\u00e9pandue, tandis que la DDR4 serait rel\u00e9gu\u00e9e \u00e0 un r\u00f4le marginal ou de niche.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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    Conclusion et perspectives<\/h2>\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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    Le passage de la DDR4 \u00e0 la DDR5 est bien plus qu'une simple m\u00e9moire plus rapide. Elle implique une complexit\u00e9 technique, une r\u00e9affectation des ressources, une restructuration du march\u00e9 et une coordination de l'\u00e9cosyst\u00e8me en aval. Nous sommes aujourd'hui \u00e0 un point de basculement structurel : La DDR5 acquiert les conditions techniques et commerciales n\u00e9cessaires pour s'\u00e9tendre, et l'espace de survie de la DDR4 se r\u00e9tr\u00e9cit.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t

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    Au cours des trois \u00e0 cinq prochaines ann\u00e9es, la p\u00e9n\u00e9tration de la DDR5 passera des plates-formes haut de gamme aux segments grand public, les co\u00fbts diminueront et le soutien de l'\u00e9cosyst\u00e8me se renforcera. Entre-temps, les applications \u00e0 large bande passante ou \u00e0 tr\u00e8s haute densit\u00e9 pourraient progressivement migrer vers la HBM, les architectures de m\u00e9moire h\u00e9t\u00e9rog\u00e8ne ou les int\u00e9grations m\u00e9moire + calcul. En d'autres termes, la DDR5 n'est pas la derni\u00e8re fronti\u00e8re, mais l'un des piliers fondamentaux du futur \u00e9cosyst\u00e8me de la m\u00e9moire.<\/p>\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t<\/div>","protected":false},"excerpt":{"rendered":"

    d'ici la seconde moiti\u00e9 de 2025, de nombreux signaux commerciaux et techniques commencent \u00e0 indiquer une nouvelle r\u00e9alit\u00e9 : la transition entre dans une phase critique. En d'autres termes, la DDR5 sort de sa phase pilote et la DDR4 est progressivement \u00e9vinc\u00e9e.<\/p>","protected":false},"author":4,"featured_media":11868,"comment_status":"closed","ping_status":"closed","sticky":false,"template":"","format":"standard","meta":{"_acf_changed":false,"site-sidebar-layout":"default","site-content-layout":"","ast-site-content-layout":"default","site-content-style":"default","site-sidebar-style":"default","ast-global-header-display":"","ast-banner-title-visibility":"","ast-main-header-display":"","ast-hfb-above-header-display":"","ast-hfb-below-header-display":"","ast-hfb-mobile-header-display":"","site-post-title":"","ast-breadcrumbs-content":"","ast-featured-img":"","footer-sml-layout":"","theme-transparent-header-meta":"","adv-header-id-meta":"","stick-header-meta":"","header-above-stick-meta":"","header-main-stick-meta":"","header-below-stick-meta":"","astra-migrate-meta-layouts":"set","ast-page-background-enabled":"default","ast-page-background-meta":{"desktop":{"background-color":"var(--ast-global-color-4)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"tablet":{"background-color":"","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"mobile":{"background-color":"","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""}},"ast-content-background-meta":{"desktop":{"background-color":"var(--ast-global-color-5)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"tablet":{"background-color":"var(--ast-global-color-5)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""},"mobile":{"background-color":"var(--ast-global-color-5)","background-image":"","background-repeat":"repeat","background-position":"center center","background-size":"auto","background-attachment":"scroll","background-type":"","background-media":"","overlay-type":"","overlay-color":"","overlay-opacity":"","overlay-gradient":""}},"footnotes":""},"categories":[52],"tags":[],"class_list":["post-11866","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-industry-news"],"acf":[],"_links":{"self":[{"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/posts\/11866","targetHints":{"allow":["GET"]}}],"collection":[{"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/posts"}],"about":[{"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/types\/post"}],"author":[{"embeddable":true,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/users\/4"}],"replies":[{"embeddable":true,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/comments?post=11866"}],"version-history":[{"count":3,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/posts\/11866\/revisions"}],"predecessor-version":[{"id":13147,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/posts\/11866\/revisions\/13147"}],"wp:featuredmedia":[{"embeddable":true,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/media\/11868"}],"wp:attachment":[{"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/media?parent=11866"}],"wp:term":[{"taxonomy":"category","embeddable":true,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/categories?post=11866"},{"taxonomy":"post_tag","embeddable":true,"href":"https:\/\/www.oscoo.com\/fr\/wp-json\/wp\/v2\/tags?post=11866"}],"curies":[{"name":"wp","href":"https:\/\/api.w.org\/{rel}","templated":true}]}}